논문 상세
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작성자
관리자
조회수
38
등록일
2024-07-23
논문 상세정보
| 과제 | 미래국방 지능형ICT 교육연구단 | ||||
|---|---|---|---|---|---|
| 논문명 | Ultralow-Latency Successive Cancellation Polar Decoding Architecture Using Tree-Level Parallelism | ||||
| 성과고유번호 | JNL-2021-00112186646 | 성과발생연도 | 2021 | 국내외구분 | |
| 학술지구분 | 학술지유형 | SCIE | |||
| 논문초록 | |||||
| 주저자 | Kam, Dongyun | 소속기관명 | 충남대학 | 기여율 | 0.0 % |
| 공동저자 | |||||
학술지
| 학술지명 | IEEE TRANSACTIONS ON VERY LARGE SCALE INTEGRATION (VLSI) SYSTEMS | 권(호) | 29 (6) | 시작페이지 | 1083 | ||
|---|---|---|---|---|---|---|---|
| DOI | 10.1109/TVLSI.2021.3068965 | ISSN | ISBN | ||||
| 최초등록 | 관리자, 2024-07-23 PM 04시 13분 | 최종수정 | 관리자, 2024-10-24 PM 01시 36분 | ||||
논문 원문